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基于数字频率合成算法的硬件PWM模块设计*

作者：朱远建,张华* 日期：2016-02-26/span> 浏览：2416 查看PDF文档

基于数字频率合成算法的硬件PWM模块设计*

朱远建,张华*

(浙江理工大学机械与自动控制学院,浙江杭州 310018)

摘要：针对伺服电机的控制问题,对控制伺服电机的脉冲发送模块、计数模块、加减速模块进行了研究。通过分析脉冲信号产生过程,提出了一种基于FPGA的宽调频范围的脉冲产生方法。该方法采用数字频率合成算法,通过硬件描述语言Verilog HDL实现该算法的逻辑,并利用Quartus II仿真软件对所产生脉冲信号和加减计数模块进行仿真测试。在伺服电机控制平台上进行测试验证,研究结果表明该算法生成的脉冲频率可调范围为1Hz~25MHz,在整个脉冲段的波动不超过一个时钟周期。该脉冲发送模块具有脉冲输出均匀稳定、分辨率高、调频范围广的优点,可以满足多种伺服控制要求,为伺服电机提供稳定的控制脉冲,具有一定的应用前景。

关键词：直接数字合成(DDS);脉冲边沿计数;有限状态机;现场可编程逻辑门阵列(FPGA)

中图分类号：TH39;TP23

文献标志码：A文章编号：1001-4551(2016)01-0084-05

本文引用格式：

朱远建,张华.基于数字频率合成算法的硬件PWM模块设计［J］.机电工程，2016，33(1)：84-87,115.

ZHU Yuan jian, ZHANG Hua. Hardware pulse width modulation module based on digital frequency synthesis algorithm

［J］.Journal of Mechanical & Electrical Engineering, 2016,33(1):84-87,115.

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