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一种PC/104总线接口的CPLD设计与实现

作者：李鹏刚　胡旭东日期：2007-03-09/span> 浏览：4036 查看PDF文档

一种PC/104总线接口的CPLD设计与实现

李鹏刚　胡旭东　

摘　要：对PC/104总线作了时序分析,设计了状态机,使用CPLD器件完成PC/104总线的接口设计,并且在Maxplus-Ⅱ环境中得到仿真验证.最终实现PC/104总线常规传输的地址译码与数据传输.
关键词：总线时序;CPLD;接口设计
分类号：TP23 　文献标识码：A
文章编号：1001-4551(2005)12-0036-03

An Interface Design For PC/104 Bus with CPLD

LI Peng-gang　 HU Xu-dong　

李鹏刚(1977-),男,山东青岛人,硕士研究生,研究方向:机电控制与自动化.
作者单位：李鹏刚（浙江理工大学,机械与自动控制学院,浙江,杭州,310018）　
　　　　　胡旭东（浙江理工大学,机械与自动控制学院,浙江,杭州,310018）　

参考文献：

[1]PC/104 Specification v2.4. PC/104 Embedded Consortium, 2001.
[2]ISA Bus Timing Diagrams. IEEE P996 draft specification, 1996.
[3]Steve Golson.. State machine design techniques for Verilog and VHDL. Trilobyte Systems, 1995.
[4]杜建国.Verilog HDL硬件描述语言[M].北京:国防工业出版社,2004.
[5]m7000s datasheet..ALTERA DEVICE DATASHEET,2003.
[6]东方人华.MAXPLUS-Ⅱ入门与提高[M].北京:清华大学出版社,2004.